Inhaltsverzeichnis
1 Einleitung und Übersicht
1.1 Motivation
1.2 Ziele und Organisation dieses Buches
1.3 VHDL Entwurfsmethodik
1.4 Syntaxnotation
2 Synthese einfacher Schaltnetze
2.1 Entity, Architektur und Signale
2.1.1 Deklaration und Verwendung lokaler Signale
2.1.2 Richtungsmodi von Signalschnittstellen
2.1.3 Deklaration von Bussignalen
2.2 Simulation von VHDL-Entwürfen
2.3 Schaltnetze mit Boole'schen Gleichungen
2.4 Synthese selektiver und bedingter Signalzuweisungen
2.5 Übungsaufgaben
3 Entwurf digitaler Funktionselemente mit Prozessen
3.1 Prozesse
3.1.1 Deklaration und Ausführung von Prozessen
3.2 Schaltnetze mit sequentiellen Anweisungen
3.2.1 Die case-Anweisung
3.2.2 Die if-Anweisung
3.2.3 Schleifenkonstrukte
3.2.3.1 for loop
3.2.3.2 ...
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